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E1接口Ipcore设计

2005年

应用技术

成果简介

IP (Intellectual Property) core设计是FPGA设计或ASIC设计中完成特定功能模块的独立宏模块，如strongARMcore等；既可以独立使用，也可以与其他IPcore协同工作。该项目采用国际流行的硬件描述语言(VerilogHDL )描述电路和算法，通过EDA软件仿真、综合，下载到FPGA实现，也可以进行ASIC流片。广泛应用在接口协议转换、多路分接复接、嵌入式系统...

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